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GS880Z36CGT-150I

Name: GSI Technology GS880Z36CGT-150I
Brand: GSI Technology
SKU: 464-GS880Z36CGT-150I
Price: 13.33 EUR
Availability: InStock

Les images sont fournies à titre indicatif
Voir les caractéristiques du produit

N° Mouser :

464-GS880Z36CGT-150I

N° de fab. :

GS880Z36CGT-150I

Fab. :

GSI Technology

Description :

SRAM 2.5 or 3.3V 256K x 36 9M

Fiche technique:

GS880Z36CGT-150I Fiche technique (PDF)

Modèle de ECAO:

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	13,33 €	13,33 €
	12,38 €	123,80 €
	12,00 €	300,00 €
	11,71 €	585,50 €
	10,42 €	750,24 €
	10,08 €	2 903,04 €
	9,84 €	4 959,36 €
	9,63 €	9 707,04 €
2 520	Devis

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Attribut de produit	Valeur d'attribut	Sélectionner l'attribut
Fabricant:	GSI Technology
Catégorie du produit:	SRAM
RoHS:
Taille de la mémoire:	9 Mbit
Organisation:	256 k x 36
Temps d'accès:	7.5 ns
Fréquence de l'horloge max.:	150 MHz
Type d'interface:	Parallel
Tension d’alimentation - Max.:	3.6 V
Tension d’alimentation - Min.:	2.3 V
Courant d’alimentation maximal:	150 mA, 160 mA
Température de fonctionnement min.:	- 40 C
Température de fonctionnement max.:	+ 85 C
Style de montage:	SMD/SMT
Package/Boîte:	TQFP-100
Conditionnement:	Tray
Marque:	GSI Technology
Type de mémoire:	SDR
Sensibles à l’humidité:	Yes
Type de produit:	SRAM
Série:	GS880Z36CGT
Nombre de pièces de l'usine:	72
Sous-catégorie:	Memory & Data Storage
Nom commercial:	NBT SRAM
Type:	NBT
Poids de l''unité:	23,025 g

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Fiche technique

GS880Z36CGT-150I Fiche technique (PDF)

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Codes de conformité

TARIC:: 8542324500
CNHTS:: 8542319090
CAHTS:: 8542320041
USHTS:: 8542320041
JPHTS:: 854232029
KRHTS:: 8542321020
MXHTS:: 8542320201
ECCN:: 3A991.b.2.b

Classifications d’origine

Pays d'origine:: Taïwan
Pays d'origine de l'assemblage:: Non disponible
Pays de diffusion:: Non disponible

Le pays est susceptible de changer au moment de l’expédition.

NBT SRAMs

GSI Technology NBT SRAMs are 144Mbit and 288Mbit Synchronous Static SRAMs that utilize all available bus bandwidth. The SRAMs achieve this by eliminating the need to insert deselect cycles when the device is switched from read to write cycles. The devices' simplified interface is designed to use a data bus's maximum bandwidth. Because it is a synchronous device, address, data inputs, and read/write control inputs are captured on the rising edge of the input clock.