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LS2084ASE711B

Name: NXP LS2084ASE711B
Brand: NXP Semiconductors
SKU: 771-LS2084ASE711B
Price: 346.7 EUR
Availability: OutOfStock

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N° Mouser :

771-LS2084ASE711B

N° de fab. :

LS2084ASE711B

Fab. :

NXP Semiconductors

Description :

Microprocesseurs - MPU Layerscape 64-bit Arm Cortex-A72, 8-core, 2.1GHz, 0 to 105C, Security enabled

Modèle de ECAO:

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Fabricant:	NXP
Catégorie du produit:	Microprocesseurs - MPU
Restrictions en matière d'expédition :	Il se peut que des documents supplémentaires soient nécessaires pour une exportation depuis les États-Unis.
RoHS:
Coeur:	ARM Cortex A72
Nombre de cœurs:	8 Core
Largeur du bus de données:	64 bit
Fréquence de l'horloge max.:	2.1 GHz
Package/Boîte:	FCPBGA-1292
Mémoire cache de niveau 1 pour instructions:	48 kB
Mémoire cache de niveau 1 pour données:	32 kB
Tension d'alimentation de fonctionnement:	1.05 V
Série:	LS2084A
Style de montage:	SMD/SMT
Température de fonctionnement min.:	0 C
Température de fonctionnement max.:	+ 105 C
Conditionnement:	Tray
Marque:	NXP Semiconductors
Taille de la RAM de données:	128 kB
Type d'interface:	Ethernet, I2C, PCI-e, Serial, USB
L2 Mémoire cache des données/instructions:	4 x 1 MB
Type de mémoire:	DDR4 SDRAM
Sensibles à l’humidité:	Yes
Nombre d'horloges/de compteurs:	4 Timer
Gamme de processeur:	QorIQ LS2084A
Type de produit:	Microprocessors - MPU
Nombre de pièces de l'usine:	21
Sous-catégorie:	Microprocessors - MPU
Nom commercial:	QorIQ
Horloges de surveillance (type watchdog):	No Watchdog Timer
Raccourcis pour l'article N°:	935371391557

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Codes de conformité

TARIC:: 8542319000
CNHTS:: 8542319091
USHTS:: 8542310045
ECCN:: 5A002.a.1

Classifications d’origine

Pays d'origine:: Corée, République de
Pays d'origine de l'assemblage:: Corée, République de
Pays de diffusion:: Taïwan

Le pays est susceptible de changer au moment de l’expédition.

Layerscape Architecture

NXP Layerscape Architecture is the underlying system architecture of the QorIQ® LS series processors. The architecture enables next-generation networks with up to 100Gb/s performance and enhanced packet processing capabilities. Design effort is simplified with a standard, open programming model and a software-aware architecture framework. This design enables customers to fully exploit the underlying hardware for maximum optimization, with the capability to easily adapt to network changes for real-time soft control over the network. A uniform hardware and software model provides the compatibility and scalability required for designing end-to-end networking equipment from home-to carrier-class products. The core-agnostic architecture incorporates the optimum core for the given application: Arm® cores or Power Architecture® cores.