SN74LV2T74QPWRQ1

Texas Instruments
595-SN74LV2T74QPWRQ1
SN74LV2T74QPWRQ1

Fab. :

Description :
Bistables Automotive 1.8-V to 5.5-V single power s

Modèle de ECAO:
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En stock: 2 917

Stock:
2 917 Expédition possible immédiatement
Délai usine :
12 Semaines Délai de production estimé en usine pour des quantités supérieures à celles indiquées.
Minimum : 1   Multiples : 1
Prix unitaire:
-,-- €
Ext. Prix:
-,-- €
Tarif est.:
Conditionnement:
Bobine complète(s) (commandez en multiples de 3000)

Prix (EUR)

Qté. Prix unitaire
Ext. Prix
Ruban à découper / MouseReel™
0,447 € 0,45 €
0,311 € 3,11 €
0,279 € 6,98 €
0,243 € 24,30 €
0,225 € 56,25 €
0,215 € 107,50 €
0,206 € 206,00 €
Bobine complète(s) (commandez en multiples de 3000)
0,194 € 582,00 €
0,189 € 1 134,00 €
† Les frais pour 5,00 € MouseReel™ seront calculés et ajoutés à votre panier. Les commandes MouseReel™ ne peuvent être ni annulées ni retournées.

Attribut de produit Valeur d'attribut Sélectionner l'attribut
Texas Instruments
Catégorie du produit: Bistables
RoHS:  
LV
TSSOP-14
CMOS
1.6 V
5.5 V
SMD/SMT
- 40 C
+ 125 C
Reel
Cut Tape
MouseReel
Marque: Texas Instruments
Nombre de lignes d'entrée: 2 Input
Nombre de lignes de sortie: 2 Output
Type de produit: Flip Flops
Série: SN74LV2T74
Nombre de pièces de l'usine: 3000
Sous-catégorie: Logic ICs
Produits trouvés:
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Attributs sélectionnés: 0

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Codes de conformité
TARIC:
8542319000
CNHTS:
8542399000
CAHTS:
8542390000
USHTS:
8542390090
MXHTS:
8542399999
ECCN:
EAR99
Classifications d’origine
Pays d'origine:
Malaisie
Pays d'origine de l'assemblage:
Non disponible
Pays de diffusion:
Non disponible
Le pays est susceptible de changer au moment de l’expédition.

Double bascule de type D SN74LV2T74/SN74LV2T74-Q1

Les doubles bascules de type D SN74LV2T74/SN74LV2T74-Q1 de Texas Instruments contiennent deux bascules indépendantes de type D à déclenchement par fronts positifs. Un niveau bas à l'entrée préréglée (PRE) met la sortie à l'état haut. Un niveau bas à l'entrée d'effacement (CLR) réinitialise le niveau bas de sortie. Les fonctions de préréglage et d'effacement sont asynchrones et ne dépendent pas des niveaux des autres entrées. Lorsque PRE et CLR sont inactifs (hauts), les données au niveau de l'entrée de données (D) répondant aux exigences de temps de configuration sont transférées aux sorties (Q, Q) sur le front montant de l'impulsion d'horloge (CLK). Le déclenchement de l'horloge se produit à un niveau de tension et n'est pas directement lié au temps de montée du signal d'horloge d'entrée (CLK). Après l'intervalle de temps de maintien, les données à l'entrée (D) peuvent être modifiées sans affecter les niveaux aux sorties (Q, Q). Le niveau de sortie est référencé à la tension d'alimentation (VCC) et prend en charge les niveaux CMOS de 1,8 V, 2,5 V, 3,3 V et 5 V.