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AS4C128M32MD4-062BAN

Name: Alliance Memory AS4C128M32MD4-062BAN
Brand: Alliance Memory
SKU: 913-C128M32MD4062BAN
Price: 39.54 EUR
Availability: OutOfStock

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N° Mouser :

913-C128M32MD4062BAN

N° de fab. :

AS4C128M32MD4-062BAN

Fab. :

Alliance Memory

Description :

DRAM LPDDR4, 4G, 128M x 32, 1.1V, 200 BALL TFBGA, 1600MHZ, ECC, AUTO TEMP - Tray

Fiche technique:

AS4C128M32MD4-062BAN Fiche technique (PDF)

Modèle de ECAO:

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Prix unitaire:

-,-- €

Ext. Prix:

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Tarif est.:

Prix (EUR)

Qté.	Prix unitaire	Ext. Prix
	39,54 €	39,54 €
	36,58 €	365,80 €
	35,41 €	885,25 €
	34,55 €	1 727,50 €
	33,58 €	3 358,00 €
	33,28 €	9 052,16 €
2 584	Devis

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Attribut de produit	Valeur d'attribut	Sélectionner l'attribut
Fabricant:	Alliance Memory
Catégorie du produit:	DRAM
RoHS:
Type:	SDRAM Mobile - LPDDR4
Taille de la mémoire:	4 Gbit
Largeur du bus de données:	32 bit
Fréquence de l'horloge max.:	1.6 GHz
Package/Boîte:	FBGA-200
Organisation:	128 M x 32
Temps d'accès:	3.5 ns
Tension d’alimentation - Min.:	1.06 V
Tension d’alimentation - Max.:	1.95 V
Température de fonctionnement min.:	- 40 C
Température de fonctionnement max.:	+ 105 C
Conditionnement:	Tray
Marque:	Alliance Memory
Pays d’assemblage:	Not Available
Pays de diffusion:	Not Available
Pays d'origine:	TW
Sensibles à l’humidité:	Yes
Style de montage:	SMD/SMT
Type de produit:	DRAM
Nombre de pièces de l'usine:	136
Sous-catégorie:	Memory & Data Storage
Courant d’alimentation maximal:	79 mA

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Fiche technique

AS4C128M32MD4-062BAN Fiche technique (PDF)

REACH Declaration (PDF)

USHTS:: 8542320036
ECCN:: EAR99

2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM

Alliance Memory 2GB/4GB/8GB/16GB/32GB LPDDR4 SDRAM is organized as 1 or 2 channels per device, and the individual channel is 8-banks and 16-bits. This product uses a double-data-rate architecture to achieve high-speed operation. The double data rate architecture is a 16n prefetch architecture with an interface. It's designed to transfer two data words per clock cycle at the I/O pins. These devices offer fully synchronous operations referenced to the rising and falling edges of the clock. The data paths are internally pipelined and 16n bits prefetched to achieve very high bandwidth.