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Altera Kit de développement modulaire FPGA/SoC (Système sur puce) Agilex™ 5 Série E 065B

Le kit de développement modulaire FPGA/SoC (Système sur puce) Altera Agilex™ 5 Série E 065BA (MK-A5E065BB32AEA) est une plateforme complète de prototypage et de référence conçes pour plateforme conçues pour l'évaluation de conceptions FPGA/SoC (Système sur puce) haute performance. L’architecture modulaire de la carte porteuse de l'Altera MK-A5E065BB32AEA offre une connectivité étendue, y compris PCIe Gén4, SFP+ (10 G), HDMI 2.0, DisplayPort 2.0 et Ethernet TSN double 2,5 G. Ces options de connectivité permettent un développement rapide des applications de calcul, de mise en réseau et embarquées. Le kit prend en charge trois banques de mémoire DDR4 (deux pour la matrice FPGA et une pour l'HPS), permettant un traitement de données à large bande passante et le développement de systèmes intégréS.

Conçu pour la flexibilité, le kit de développement modilaire FPGA et SoC (Système sur puce) Agilex 5 série E 065B (dispositif du Groupe B) comprend des connecteurs FMC+ et MIPI pour l'extension aux applications de vision, d'intelligence artificielle (IA) et industrielles. L’interface utilisateur graphique (GUI) du système intégré de test de carte (BTS) simplifie la validation des horloges, de l’alimentation, de la mémoire et des émetteurs-récepteurs. Avec un USB-JTAG intégré, des horloges programmables et une gestion robuste de l'alimentation via MAX 10, ce kit est idéal pour les développeurs qui créent des systèmes avancés dans les domaines de la mise en réseau, de l'IA de bord et de l'informatique intégrée.

Caractéristiques

  • Comprend le FPGA Agilex 5 et le SoC (Système sur puce) série E (A5ED065BB32AE4S) 065B (Groupe B dispositif)
  • Comprend des cartes modulaires et porteuses offrant une large gamme d'option de connectivité et d'extension
  • Prend en charge les interfaces à haute vitesse, y compris PCIe Gén4 x4, SFP+ (10 G), HDMI 2.0 et DisplayPort 2.0
  • Comprend trois banques de mémoire DDR4 de 8 Go pour la structure FPGA et HPS, avec prise en charge du conducteur de masse
  • Offre des processeurs double cœur Arm®Cortex®-A76 et double cœur Cortex-A55 pour le traitement intégré
  • Fournit un port d’extension FMC+ et des connecteurs de caméra MIPI pour les applications de vision
  • Interface utilisateur graphique (GUI) de système de test de carte intégrée (BTS) pour les tests horloge, alimentation, mémoire et émetteur-récepteur
  • Câble de téléchargement intégré FPGA II et embase JTAG pour la programmation et le débogage
  • Inclut des générateurs d'horloge programmables et une surveillance de l'alimentation via 10 BMC
  • Distribué avec une image GHRD préchargée et une carte SD pour le démarrage HPS, avec des outils de restauration inclus
  • Conçu pour une utilisation sur banc d’essai ou carte d’extension PCIe avec refroidissement par dissipateur thermique actif

Applications

  • Contrôle d'accès
  • Centre de données cloud (public, privé et hybride)
  • FEO de centre de données (IHV, ISV, SI et VAR)
    • IA/HPC
    • Réseaux
  • Défense et gouvernement
  • Industrie
    • Énergie
    • Production industrielle
    • Robotique
    • Vision
  • Test
    • ETA
    • Testeur de communication
  • Proto ASIC
  • Grand public
  • Applications médicales
    • Imagerie
    • Laboratoire/biologie
    • Dispositifs patients hors imagerie
    • Ultrasons
    • Vidéo
  • Transport
    • Infrastructures avec ou sans chargement
    • Transport non automobile
  • Sans fil
    • Bande de base
    • DAS/répéteur/RIS

Caractéristiques techniques

  • Connecteurs
    • Connecteur FMC
    • Connecteur de bord PCIe Gén4 x16
    • Connecteur micro USB
    • Port pour carte micro SD
    • Connecteurs HDMI
    • Connecteurs MIPI0 et MIPI1
    • Connecteurs HVIO (2x20 et 2x4)
    • Connecteurs SDI RX et TX
    • Connecteur USB Type-C®
    • Connecteur Mictor HPS
    • Connecteurs I2C
  • Commutateurs et LED
    • MSEL, broches GPIO et commutateurs de boîtier DIP utilisateur
    • Boutons-poussoirs
    • LED CONF_DONE, HEARTBEAT et STATUS
    • LED utilisateur rouge et verte
    • Commutateurs pour la sélection de la source JTAG
    • Commutateurs pour le contrôle PHY et MIPI
    • Commutateurs pour le contournement JTAG FMC
    • Commutateurs pour la sélection de l'horloge PCIe
    • Commutateurs pour le mode de configuration
    • Contrôle MLI et tachymètre des ventilateurs
  • Facteur de forme de bureau et PCIe
  • Alimentation d’entrée de 12 VCC via un connecteur ATX, adaptateur de puissance 240 W inclus
  •  Interfaces
    • Ethernet RJ45 2.5G
    • 4x PCIe Gen4
    • SFP+ 10G
    • USB 3,1
    • Interface UART
    • DisplayPort 2.0 (Rx/Tx)
    • HDMI 2.0 (Rx/Tx)
    • Synchronisation tri-niveau via SMA
    • Entrée/sortie 1 PPS via SMA
    • Connecteurs de broches GPIO
    • Interfaces I2C et SPI
    • JTAG via USB ou embase externe
  • Mémoire
    • 8 Go DDR4 2 133 MHz x32 (pas de conducteur de masse)
    • 8 Go DDR4 2 133 MHz x32 + conducteur de masse
    • 8 Go DDR4 2 133 MHz x32 + conducteur de masse (HPS)
    • Configuration 4x Flash QSPI pour AS

Contenu du kit

  • Carte mère FPGA
  • Carte porteuse PCIe
  • Alimentation électrique
  • Cordons d'alimentation
  • Câbles USB
  • Carte Micro SD et adaptateur Micro SD vers SD
  • Lecteur Micro SD double interface
  • Câble Ethernet CAT6

Présentation générale

Plan mécanique - Altera Kit de développement modulaire FPGA/SoC (Système sur puce) Agilex™ 5 Série E 065B

Schéma fonctionnel

Schéma de principe - Altera Kit de développement modulaire FPGA/SoC (Système sur puce) Agilex™ 5 Série E 065B

Composants embarqués

Altera FPGA et SoC Agilex™ 5

Les FPGA de milieu de gamme sont optimisés pour des performances élevées, une faible consommation d'énergie et des petits boîtiers.

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Outil de développement associé

Altera Kit de développement de première qualité 065A Série E FPGA Agilex™ 5

Plateforme complète pour le développement et la validation de conceptions FPGA et SoC hautes performances.

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Solution d'application

Altera Pile de solutions robotiques

Un cadre structuré en couches de matériel, de logiciel et de blocs sur IP qui permettent à un robot de percevoir, de réfléchir et d’agir.

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Publié le: 2026-03-27 | Mis à jour le: 2026-07-16